target/ppc/translate/vector-impl.c.inc

   1 /*
   2  * Power ISA decode for Vector Facility instructions
   3  *
   4  * Copyright (c) 2021 Instituto de Pesquisas Eldorado (eldorado.org.br)
   5  *
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  15  *
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  18  */
  19
  20 static bool trans_VCFUGED(DisasContext *ctx, arg_VX *a)
  21 {
  22     TCGv_i64 tgt, src, mask;
  23
  24     REQUIRE_INSNS_FLAGS2(ctx, ISA310);
  25     REQUIRE_VECTOR(ctx);
  26
  27     tgt = tcg_temp_new_i64();
  28     src = tcg_temp_new_i64();
  29     mask = tcg_temp_new_i64();
  30
  31     /* centrifuge lower double word */
  32     get_cpu_vsrl(src, a->vra + 32);
  33     get_cpu_vsrl(mask, a->vrb + 32);
  34     gen_helper_cfuged(tgt, src, mask);
  35     set_cpu_vsrl(a->vrt + 32, tgt);
  36
  37     /* centrifuge higher double word */
  38     get_cpu_vsrh(src, a->vra + 32);
  39     get_cpu_vsrh(mask, a->vrb + 32);
  40     gen_helper_cfuged(tgt, src, mask);
  41     set_cpu_vsrh(a->vrt + 32, tgt);
  42
  43     tcg_temp_free_i64(tgt);
  44     tcg_temp_free_i64(src);
  45     tcg_temp_free_i64(mask);
  46
  47     return true;
  48 }