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1 # SPDX-License-Identifier: GPL-2.0-or-later
2 #
3 # LoongArch instruction decode definitions.
4 #
5 # Copyright (c) 2021 Loongson Technology Corporation Limited
6 #
8 #
9 # Fields
10 #
11 %i14s2 10:s14 !function=shl_2
12 %sa2p1 15:2 !function=plus_1
13 %offs21 0:s5 10:16 !function=shl_2
14 %offs16 10:s16 !function=shl_2
15 %offs26 0:s10 10:16 !function=shl_2
17 #
18 # Argument sets
19 #
20 &i imm
21 &r_i rd imm
22 &rr rd rj
23 &rr_jk rj rk
24 &rrr rd rj rk
25 &rr_i rd rj imm
26 &hint_r_i hint rj imm
27 &rrr_sa rd rj rk sa
28 &rr_ms_ls rd rj ms ls
29 &ff fd fj
30 &fff fd fj fk
31 &ffff fd fj fk fa
32 &cff_fcond cd fj fk fcond
33 &fffc fd fj fk ca
34 &fr fd rj
35 &rf rd fj
36 &fcsrd_r fcsrd rj
37 &r_fcsrs rd fcsrs
38 &cf cd fj
39 &fc fd cj
40 &cr cd rj
41 &rc rd cj
42 &frr fd rj rk
43 &fr_i fd rj imm
44 &r_offs rj offs
45 &c_offs cj offs
46 &offs offs
47 &rr_offs rj rd offs
48 &r_csr rd csr
49 &rr_csr rd rj csr
50 &empty
51 &i_rr imm rj rk
52 &cop_r_i cop rj imm
53 &j_i rj imm
55 #
56 # Formats
57 #
58 @i15 .... ........ ..... imm:15 &i
59 @rr .... ........ ..... ..... rj:5 rd:5 &rr
60 @rr_jk .... ........ ..... rk:5 rj:5 ..... &rr_jk
61 @rrr .... ........ ..... rk:5 rj:5 rd:5 &rrr
62 @r_i20 .... ... imm:s20 rd:5 &r_i
63 @rr_ui5 .... ........ ..... imm:5 rj:5 rd:5 &rr_i
64 @rr_ui6 .... ........ .... imm:6 rj:5 rd:5 &rr_i
65 @rr_ui8 .. ........ .... imm:8 rj:5 rd:5 &rr_i
66 @rr_i12 .... ...... imm:s12 rj:5 rd:5 &rr_i
67 @rr_ui12 .... ...... imm:12 rj:5 rd:5 &rr_i
68 @rr_i14s2 .... .... .............. rj:5 rd:5 &rr_i imm=%i14s2
69 @rr_i16 .... .. imm:s16 rj:5 rd:5 &rr_i
70 @rr_i16s2 .... .. ................ rj:5 rd:5 &rr_i imm=%offs16
71 @hint_r_i12 .... ...... imm:s12 rj:5 hint:5 &hint_r_i
72 @rrr_sa2p1 .... ........ ... .. rk:5 rj:5 rd:5 &rrr_sa sa=%sa2p1
73 @rrr_sa2 .... ........ ... sa:2 rk:5 rj:5 rd:5 &rrr_sa
74 @rrr_sa3 .... ........ .. sa:3 rk:5 rj:5 rd:5 &rrr_sa
75 @rr_2bw .... ....... ms:5 . ls:5 rj:5 rd:5 &rr_ms_ls
76 @rr_2bd .... ...... ms:6 ls:6 rj:5 rd:5 &rr_ms_ls
77 @ff .... ........ ..... ..... fj:5 fd:5 &ff
78 @fff .... ........ ..... fk:5 fj:5 fd:5 &fff
79 @ffff .... ........ fa:5 fk:5 fj:5 fd:5 &ffff
80 @cff_fcond .... ........ fcond:5 fk:5 fj:5 .. cd:3 &cff_fcond
81 @fffc .... ........ .. ca:3 fk:5 fj:5 fd:5 &fffc
82 @fr .... ........ ..... ..... rj:5 fd:5 &fr
83 @rf .... ........ ..... ..... fj:5 rd:5 &rf
84 @fcsrd_r .... ........ ..... ..... rj:5 fcsrd:5 &fcsrd_r
85 @r_fcsrs .... ........ ..... ..... fcsrs:5 rd:5 &r_fcsrs
86 @cf .... ........ ..... ..... fj:5 .. cd:3 &cf
87 @fc .... ........ ..... ..... .. cj:3 fd:5 &fc
88 @cr .... ........ ..... ..... rj:5 .. cd:3 &cr
89 @rc .... ........ ..... ..... .. cj:3 rd:5 &rc
90 @frr .... ........ ..... rk:5 rj:5 fd:5 &frr
91 @fr_i12 .... ...... imm:s12 rj:5 fd:5 &fr_i
92 @r_offs21 .... .. ................ rj:5 ..... &r_offs offs=%offs21
93 @c_offs21 .... .. ................ .. cj:3 ..... &c_offs offs=%offs21
94 @offs26 .... .. .......................... &offs offs=%offs26
95 @rr_offs16 .... .. ................ rj:5 rd:5 &rr_offs offs=%offs16
96 @r_csr .... .... csr:14 ..... rd:5 &r_csr
97 @rr_csr .... .... csr:14 rj:5 rd:5 &rr_csr
98 @empty .... ........ ..... ..... ..... ..... &empty
99 @i_rr ...... ...... ..... rk:5 rj:5 imm:5 &i_rr
100 @cop_r_i .... ...... imm:s12 rj:5 cop:5 &cop_r_i
101 @j_i .... ........ .. imm:8 rj:5 ..... &j_i
103 #
104 # Fixed point arithmetic operation instruction
105 #
106 add_w 0000 00000001 00000 ..... ..... ..... @rrr
107 add_d 0000 00000001 00001 ..... ..... ..... @rrr
108 sub_w 0000 00000001 00010 ..... ..... ..... @rrr
109 sub_d 0000 00000001 00011 ..... ..... ..... @rrr
110 slt 0000 00000001 00100 ..... ..... ..... @rrr
111 sltu 0000 00000001 00101 ..... ..... ..... @rrr
112 slti 0000 001000 ............ ..... ..... @rr_i12
113 sltui 0000 001001 ............ ..... ..... @rr_i12
114 nor 0000 00000001 01000 ..... ..... ..... @rrr
115 and 0000 00000001 01001 ..... ..... ..... @rrr
116 or 0000 00000001 01010 ..... ..... ..... @rrr
117 xor 0000 00000001 01011 ..... ..... ..... @rrr
118 orn 0000 00000001 01100 ..... ..... ..... @rrr
119 andn 0000 00000001 01101 ..... ..... ..... @rrr
120 mul_w 0000 00000001 11000 ..... ..... ..... @rrr
121 mulh_w 0000 00000001 11001 ..... ..... ..... @rrr
122 mulh_wu 0000 00000001 11010 ..... ..... ..... @rrr
123 mul_d 0000 00000001 11011 ..... ..... ..... @rrr
124 mulh_d 0000 00000001 11100 ..... ..... ..... @rrr
125 mulh_du 0000 00000001 11101 ..... ..... ..... @rrr
126 mulw_d_w 0000 00000001 11110 ..... ..... ..... @rrr
127 mulw_d_wu 0000 00000001 11111 ..... ..... ..... @rrr
128 div_w 0000 00000010 00000 ..... ..... ..... @rrr
129 mod_w 0000 00000010 00001 ..... ..... ..... @rrr
130 div_wu 0000 00000010 00010 ..... ..... ..... @rrr
131 mod_wu 0000 00000010 00011 ..... ..... ..... @rrr
132 div_d 0000 00000010 00100 ..... ..... ..... @rrr
133 mod_d 0000 00000010 00101 ..... ..... ..... @rrr
134 div_du 0000 00000010 00110 ..... ..... ..... @rrr
135 mod_du 0000 00000010 00111 ..... ..... ..... @rrr
136 alsl_w 0000 00000000 010 .. ..... ..... ..... @rrr_sa2p1
137 alsl_wu 0000 00000000 011 .. ..... ..... ..... @rrr_sa2p1
138 alsl_d 0000 00000010 110 .. ..... ..... ..... @rrr_sa2p1
139 lu12i_w 0001 010 .................... ..... @r_i20
140 lu32i_d 0001 011 .................... ..... @r_i20
141 lu52i_d 0000 001100 ............ ..... ..... @rr_i12
142 pcaddi 0001 100 .................... ..... @r_i20
143 pcalau12i 0001 101 .................... ..... @r_i20
144 pcaddu12i 0001 110 .................... ..... @r_i20
145 pcaddu18i 0001 111 .................... ..... @r_i20
146 addi_w 0000 001010 ............ ..... ..... @rr_i12
147 addi_d 0000 001011 ............ ..... ..... @rr_i12
148 addu16i_d 0001 00 ................ ..... ..... @rr_i16
149 andi 0000 001101 ............ ..... ..... @rr_ui12
150 ori 0000 001110 ............ ..... ..... @rr_ui12
151 xori 0000 001111 ............ ..... ..... @rr_ui12
153 #
154 # Fixed point shift operation instruction
155 #
156 sll_w 0000 00000001 01110 ..... ..... ..... @rrr
157 srl_w 0000 00000001 01111 ..... ..... ..... @rrr
158 sra_w 0000 00000001 10000 ..... ..... ..... @rrr
159 sll_d 0000 00000001 10001 ..... ..... ..... @rrr
160 srl_d 0000 00000001 10010 ..... ..... ..... @rrr
161 sra_d 0000 00000001 10011 ..... ..... ..... @rrr
162 rotr_w 0000 00000001 10110 ..... ..... ..... @rrr
163 rotr_d 0000 00000001 10111 ..... ..... ..... @rrr
164 slli_w 0000 00000100 00001 ..... ..... ..... @rr_ui5
165 slli_d 0000 00000100 0001 ...... ..... ..... @rr_ui6
166 srli_w 0000 00000100 01001 ..... ..... ..... @rr_ui5
167 srli_d 0000 00000100 0101 ...... ..... ..... @rr_ui6
168 srai_w 0000 00000100 10001 ..... ..... ..... @rr_ui5
169 srai_d 0000 00000100 1001 ...... ..... ..... @rr_ui6
170 rotri_w 0000 00000100 11001 ..... ..... ..... @rr_ui5
171 rotri_d 0000 00000100 1101 ...... ..... ..... @rr_ui6
173 #
174 # Fixed point bit operation instruction
175 #
176 ext_w_h 0000 00000000 00000 10110 ..... ..... @rr
177 ext_w_b 0000 00000000 00000 10111 ..... ..... @rr
178 clo_w 0000 00000000 00000 00100 ..... ..... @rr
179 clz_w 0000 00000000 00000 00101 ..... ..... @rr
180 cto_w 0000 00000000 00000 00110 ..... ..... @rr
181 ctz_w 0000 00000000 00000 00111 ..... ..... @rr
182 clo_d 0000 00000000 00000 01000 ..... ..... @rr
183 clz_d 0000 00000000 00000 01001 ..... ..... @rr
184 cto_d 0000 00000000 00000 01010 ..... ..... @rr
185 ctz_d 0000 00000000 00000 01011 ..... ..... @rr
186 revb_2h 0000 00000000 00000 01100 ..... ..... @rr
187 revb_4h 0000 00000000 00000 01101 ..... ..... @rr
188 revb_2w 0000 00000000 00000 01110 ..... ..... @rr
189 revb_d 0000 00000000 00000 01111 ..... ..... @rr
190 revh_2w 0000 00000000 00000 10000 ..... ..... @rr
191 revh_d 0000 00000000 00000 10001 ..... ..... @rr
192 bitrev_4b 0000 00000000 00000 10010 ..... ..... @rr
193 bitrev_8b 0000 00000000 00000 10011 ..... ..... @rr
194 bitrev_w 0000 00000000 00000 10100 ..... ..... @rr
195 bitrev_d 0000 00000000 00000 10101 ..... ..... @rr
196 bytepick_w 0000 00000000 100 .. ..... ..... ..... @rrr_sa2
197 bytepick_d 0000 00000000 11 ... ..... ..... ..... @rrr_sa3
198 maskeqz 0000 00000001 00110 ..... ..... ..... @rrr
199 masknez 0000 00000001 00111 ..... ..... ..... @rrr
200 bstrins_w 0000 0000011 ..... 0 ..... ..... ..... @rr_2bw
201 bstrpick_w 0000 0000011 ..... 1 ..... ..... ..... @rr_2bw
202 bstrins_d 0000 000010 ...... ...... ..... ..... @rr_2bd
203 bstrpick_d 0000 000011 ...... ...... ..... ..... @rr_2bd
205 #
206 # Fixed point load/store instruction
207 #
208 ld_b 0010 100000 ............ ..... ..... @rr_i12
209 ld_h 0010 100001 ............ ..... ..... @rr_i12
210 ld_w 0010 100010 ............ ..... ..... @rr_i12
211 ld_d 0010 100011 ............ ..... ..... @rr_i12
212 st_b 0010 100100 ............ ..... ..... @rr_i12
213 st_h 0010 100101 ............ ..... ..... @rr_i12
214 st_w 0010 100110 ............ ..... ..... @rr_i12
215 st_d 0010 100111 ............ ..... ..... @rr_i12
216 ld_bu 0010 101000 ............ ..... ..... @rr_i12
217 ld_hu 0010 101001 ............ ..... ..... @rr_i12
218 ld_wu 0010 101010 ............ ..... ..... @rr_i12
219 ldx_b 0011 10000000 00000 ..... ..... ..... @rrr
220 ldx_h 0011 10000000 01000 ..... ..... ..... @rrr
221 ldx_w 0011 10000000 10000 ..... ..... ..... @rrr
222 ldx_d 0011 10000000 11000 ..... ..... ..... @rrr
223 stx_b 0011 10000001 00000 ..... ..... ..... @rrr
224 stx_h 0011 10000001 01000 ..... ..... ..... @rrr
225 stx_w 0011 10000001 10000 ..... ..... ..... @rrr
226 stx_d 0011 10000001 11000 ..... ..... ..... @rrr
227 ldx_bu 0011 10000010 00000 ..... ..... ..... @rrr
228 ldx_hu 0011 10000010 01000 ..... ..... ..... @rrr
229 ldx_wu 0011 10000010 10000 ..... ..... ..... @rrr
230 preld 0010 101011 ............ ..... ..... @hint_r_i12
231 dbar 0011 10000111 00100 ............... @i15
232 ibar 0011 10000111 00101 ............... @i15
233 ldptr_w 0010 0100 .............. ..... ..... @rr_i14s2
234 stptr_w 0010 0101 .............. ..... ..... @rr_i14s2
235 ldptr_d 0010 0110 .............. ..... ..... @rr_i14s2
236 stptr_d 0010 0111 .............. ..... ..... @rr_i14s2
237 ldgt_b 0011 10000111 10000 ..... ..... ..... @rrr
238 ldgt_h 0011 10000111 10001 ..... ..... ..... @rrr
239 ldgt_w 0011 10000111 10010 ..... ..... ..... @rrr
240 ldgt_d 0011 10000111 10011 ..... ..... ..... @rrr
241 ldle_b 0011 10000111 10100 ..... ..... ..... @rrr
242 ldle_h 0011 10000111 10101 ..... ..... ..... @rrr
243 ldle_w 0011 10000111 10110 ..... ..... ..... @rrr
244 ldle_d 0011 10000111 10111 ..... ..... ..... @rrr
245 stgt_b 0011 10000111 11000 ..... ..... ..... @rrr
246 stgt_h 0011 10000111 11001 ..... ..... ..... @rrr
247 stgt_w 0011 10000111 11010 ..... ..... ..... @rrr
248 stgt_d 0011 10000111 11011 ..... ..... ..... @rrr
249 stle_b 0011 10000111 11100 ..... ..... ..... @rrr
250 stle_h 0011 10000111 11101 ..... ..... ..... @rrr
251 stle_w 0011 10000111 11110 ..... ..... ..... @rrr
252 stle_d 0011 10000111 11111 ..... ..... ..... @rrr
254 #
255 # Fixed point atomic instruction
256 #
257 ll_w 0010 0000 .............. ..... ..... @rr_i14s2
258 sc_w 0010 0001 .............. ..... ..... @rr_i14s2
259 ll_d 0010 0010 .............. ..... ..... @rr_i14s2
260 sc_d 0010 0011 .............. ..... ..... @rr_i14s2
261 amswap_w 0011 10000110 00000 ..... ..... ..... @rrr
262 amswap_d 0011 10000110 00001 ..... ..... ..... @rrr
263 amadd_w 0011 10000110 00010 ..... ..... ..... @rrr
264 amadd_d 0011 10000110 00011 ..... ..... ..... @rrr
265 amand_w 0011 10000110 00100 ..... ..... ..... @rrr
266 amand_d 0011 10000110 00101 ..... ..... ..... @rrr
267 amor_w 0011 10000110 00110 ..... ..... ..... @rrr
268 amor_d 0011 10000110 00111 ..... ..... ..... @rrr
269 amxor_w 0011 10000110 01000 ..... ..... ..... @rrr
270 amxor_d 0011 10000110 01001 ..... ..... ..... @rrr
271 ammax_w 0011 10000110 01010 ..... ..... ..... @rrr
272 ammax_d 0011 10000110 01011 ..... ..... ..... @rrr
273 ammin_w 0011 10000110 01100 ..... ..... ..... @rrr
274 ammin_d 0011 10000110 01101 ..... ..... ..... @rrr
275 ammax_wu 0011 10000110 01110 ..... ..... ..... @rrr
276 ammax_du 0011 10000110 01111 ..... ..... ..... @rrr
277 ammin_wu 0011 10000110 10000 ..... ..... ..... @rrr
278 ammin_du 0011 10000110 10001 ..... ..... ..... @rrr
279 amswap_db_w 0011 10000110 10010 ..... ..... ..... @rrr
280 amswap_db_d 0011 10000110 10011 ..... ..... ..... @rrr
281 amadd_db_w 0011 10000110 10100 ..... ..... ..... @rrr
282 amadd_db_d 0011 10000110 10101 ..... ..... ..... @rrr
283 amand_db_w 0011 10000110 10110 ..... ..... ..... @rrr
284 amand_db_d 0011 10000110 10111 ..... ..... ..... @rrr
285 amor_db_w 0011 10000110 11000 ..... ..... ..... @rrr
286 amor_db_d 0011 10000110 11001 ..... ..... ..... @rrr
287 amxor_db_w 0011 10000110 11010 ..... ..... ..... @rrr
288 amxor_db_d 0011 10000110 11011 ..... ..... ..... @rrr
289 ammax_db_w 0011 10000110 11100 ..... ..... ..... @rrr
290 ammax_db_d 0011 10000110 11101 ..... ..... ..... @rrr
291 ammin_db_w 0011 10000110 11110 ..... ..... ..... @rrr
292 ammin_db_d 0011 10000110 11111 ..... ..... ..... @rrr
293 ammax_db_wu 0011 10000111 00000 ..... ..... ..... @rrr
294 ammax_db_du 0011 10000111 00001 ..... ..... ..... @rrr
295 ammin_db_wu 0011 10000111 00010 ..... ..... ..... @rrr
296 ammin_db_du 0011 10000111 00011 ..... ..... ..... @rrr
298 #
299 # Fixed point extra instruction
300 #
301 crc_w_b_w 0000 00000010 01000 ..... ..... ..... @rrr
302 crc_w_h_w 0000 00000010 01001 ..... ..... ..... @rrr
303 crc_w_w_w 0000 00000010 01010 ..... ..... ..... @rrr
304 crc_w_d_w 0000 00000010 01011 ..... ..... ..... @rrr
305 crcc_w_b_w 0000 00000010 01100 ..... ..... ..... @rrr
306 crcc_w_h_w 0000 00000010 01101 ..... ..... ..... @rrr
307 crcc_w_w_w 0000 00000010 01110 ..... ..... ..... @rrr
308 crcc_w_d_w 0000 00000010 01111 ..... ..... ..... @rrr
309 break 0000 00000010 10100 ............... @i15
310 syscall 0000 00000010 10110 ............... @i15
311 asrtle_d 0000 00000000 00010 ..... ..... 00000 @rr_jk
312 asrtgt_d 0000 00000000 00011 ..... ..... 00000 @rr_jk
313 rdtimel_w 0000 00000000 00000 11000 ..... ..... @rr
314 rdtimeh_w 0000 00000000 00000 11001 ..... ..... @rr
315 rdtime_d 0000 00000000 00000 11010 ..... ..... @rr
316 cpucfg 0000 00000000 00000 11011 ..... ..... @rr
318 #
319 # Floating point arithmetic operation instruction
320 #
321 fadd_s 0000 00010000 00001 ..... ..... ..... @fff
322 fadd_d 0000 00010000 00010 ..... ..... ..... @fff
323 fsub_s 0000 00010000 00101 ..... ..... ..... @fff
324 fsub_d 0000 00010000 00110 ..... ..... ..... @fff
325 fmul_s 0000 00010000 01001 ..... ..... ..... @fff
326 fmul_d 0000 00010000 01010 ..... ..... ..... @fff
327 fdiv_s 0000 00010000 01101 ..... ..... ..... @fff
328 fdiv_d 0000 00010000 01110 ..... ..... ..... @fff
329 fmadd_s 0000 10000001 ..... ..... ..... ..... @ffff
330 fmadd_d 0000 10000010 ..... ..... ..... ..... @ffff
331 fmsub_s 0000 10000101 ..... ..... ..... ..... @ffff
332 fmsub_d 0000 10000110 ..... ..... ..... ..... @ffff
333 fnmadd_s 0000 10001001 ..... ..... ..... ..... @ffff
334 fnmadd_d 0000 10001010 ..... ..... ..... ..... @ffff
335 fnmsub_s 0000 10001101 ..... ..... ..... ..... @ffff
336 fnmsub_d 0000 10001110 ..... ..... ..... ..... @ffff
337 fmax_s 0000 00010000 10001 ..... ..... ..... @fff
338 fmax_d 0000 00010000 10010 ..... ..... ..... @fff
339 fmin_s 0000 00010000 10101 ..... ..... ..... @fff
340 fmin_d 0000 00010000 10110 ..... ..... ..... @fff
341 fmaxa_s 0000 00010000 11001 ..... ..... ..... @fff
342 fmaxa_d 0000 00010000 11010 ..... ..... ..... @fff
343 fmina_s 0000 00010000 11101 ..... ..... ..... @fff
344 fmina_d 0000 00010000 11110 ..... ..... ..... @fff
345 fabs_s 0000 00010001 01000 00001 ..... ..... @ff
346 fabs_d 0000 00010001 01000 00010 ..... ..... @ff
347 fneg_s 0000 00010001 01000 00101 ..... ..... @ff
348 fneg_d 0000 00010001 01000 00110 ..... ..... @ff
349 fsqrt_s 0000 00010001 01000 10001 ..... ..... @ff
350 fsqrt_d 0000 00010001 01000 10010 ..... ..... @ff
351 frecip_s 0000 00010001 01000 10101 ..... ..... @ff
352 frecip_d 0000 00010001 01000 10110 ..... ..... @ff
353 frsqrt_s 0000 00010001 01000 11001 ..... ..... @ff
354 frsqrt_d 0000 00010001 01000 11010 ..... ..... @ff
355 fscaleb_s 0000 00010001 00001 ..... ..... ..... @fff
356 fscaleb_d 0000 00010001 00010 ..... ..... ..... @fff
357 flogb_s 0000 00010001 01000 01001 ..... ..... @ff
358 flogb_d 0000 00010001 01000 01010 ..... ..... @ff
359 fcopysign_s 0000 00010001 00101 ..... ..... ..... @fff
360 fcopysign_d 0000 00010001 00110 ..... ..... ..... @fff
361 fclass_s 0000 00010001 01000 01101 ..... ..... @ff
362 fclass_d 0000 00010001 01000 01110 ..... ..... @ff
364 #
365 # Floating point compare instruction
366 #
367 fcmp_cond_s 0000 11000001 ..... ..... ..... 00 ... @cff_fcond
368 fcmp_cond_d 0000 11000010 ..... ..... ..... 00 ... @cff_fcond
370 #
371 # Floating point conversion instruction
372 #
373 fcvt_s_d 0000 00010001 10010 00110 ..... ..... @ff
374 fcvt_d_s 0000 00010001 10010 01001 ..... ..... @ff
375 ftintrm_w_s 0000 00010001 10100 00001 ..... ..... @ff
376 ftintrm_w_d 0000 00010001 10100 00010 ..... ..... @ff
377 ftintrm_l_s 0000 00010001 10100 01001 ..... ..... @ff
378 ftintrm_l_d 0000 00010001 10100 01010 ..... ..... @ff
379 ftintrp_w_s 0000 00010001 10100 10001 ..... ..... @ff
380 ftintrp_w_d 0000 00010001 10100 10010 ..... ..... @ff
381 ftintrp_l_s 0000 00010001 10100 11001 ..... ..... @ff
382 ftintrp_l_d 0000 00010001 10100 11010 ..... ..... @ff
383 ftintrz_w_s 0000 00010001 10101 00001 ..... ..... @ff
384 ftintrz_w_d 0000 00010001 10101 00010 ..... ..... @ff
385 ftintrz_l_s 0000 00010001 10101 01001 ..... ..... @ff
386 ftintrz_l_d 0000 00010001 10101 01010 ..... ..... @ff
387 ftintrne_w_s 0000 00010001 10101 10001 ..... ..... @ff
388 ftintrne_w_d 0000 00010001 10101 10010 ..... ..... @ff
389 ftintrne_l_s 0000 00010001 10101 11001 ..... ..... @ff
390 ftintrne_l_d 0000 00010001 10101 11010 ..... ..... @ff
391 ftint_w_s 0000 00010001 10110 00001 ..... ..... @ff
392 ftint_w_d 0000 00010001 10110 00010 ..... ..... @ff
393 ftint_l_s 0000 00010001 10110 01001 ..... ..... @ff
394 ftint_l_d 0000 00010001 10110 01010 ..... ..... @ff
395 ffint_s_w 0000 00010001 11010 00100 ..... ..... @ff
396 ffint_s_l 0000 00010001 11010 00110 ..... ..... @ff
397 ffint_d_w 0000 00010001 11010 01000 ..... ..... @ff
398 ffint_d_l 0000 00010001 11010 01010 ..... ..... @ff
399 frint_s 0000 00010001 11100 10001 ..... ..... @ff
400 frint_d 0000 00010001 11100 10010 ..... ..... @ff
402 #
403 # Floating point move instruction
404 #
405 fmov_s 0000 00010001 01001 00101 ..... ..... @ff
406 fmov_d 0000 00010001 01001 00110 ..... ..... @ff
407 fsel 0000 11010000 00 ... ..... ..... ..... @fffc
408 movgr2fr_w 0000 00010001 01001 01001 ..... ..... @fr
409 movgr2fr_d 0000 00010001 01001 01010 ..... ..... @fr
410 movgr2frh_w 0000 00010001 01001 01011 ..... ..... @fr
411 movfr2gr_s 0000 00010001 01001 01101 ..... ..... @rf
412 movfr2gr_d 0000 00010001 01001 01110 ..... ..... @rf
413 movfrh2gr_s 0000 00010001 01001 01111 ..... ..... @rf
414 movgr2fcsr 0000 00010001 01001 10000 ..... ..... @fcsrd_r
415 movfcsr2gr 0000 00010001 01001 10010 ..... ..... @r_fcsrs
416 movfr2cf 0000 00010001 01001 10100 ..... 00 ... @cf
417 movcf2fr 0000 00010001 01001 10101 00 ... ..... @fc
418 movgr2cf 0000 00010001 01001 10110 ..... 00 ... @cr
419 movcf2gr 0000 00010001 01001 10111 00 ... ..... @rc
421 #
422 # Floating point load/store instruction
423 #
424 fld_s 0010 101100 ............ ..... ..... @fr_i12
425 fst_s 0010 101101 ............ ..... ..... @fr_i12
426 fld_d 0010 101110 ............ ..... ..... @fr_i12
427 fst_d 0010 101111 ............ ..... ..... @fr_i12
428 fldx_s 0011 10000011 00000 ..... ..... ..... @frr
429 fldx_d 0011 10000011 01000 ..... ..... ..... @frr
430 fstx_s 0011 10000011 10000 ..... ..... ..... @frr
431 fstx_d 0011 10000011 11000 ..... ..... ..... @frr
432 fldgt_s 0011 10000111 01000 ..... ..... ..... @frr
433 fldgt_d 0011 10000111 01001 ..... ..... ..... @frr
434 fldle_s 0011 10000111 01010 ..... ..... ..... @frr
435 fldle_d 0011 10000111 01011 ..... ..... ..... @frr
436 fstgt_s 0011 10000111 01100 ..... ..... ..... @frr
437 fstgt_d 0011 10000111 01101 ..... ..... ..... @frr
438 fstle_s 0011 10000111 01110 ..... ..... ..... @frr
439 fstle_d 0011 10000111 01111 ..... ..... ..... @frr
441 #
442 # Branch instructions
443 #
444 beqz 0100 00 ................ ..... ..... @r_offs21
445 bnez 0100 01 ................ ..... ..... @r_offs21
446 bceqz 0100 10 ................ 00 ... ..... @c_offs21
447 bcnez 0100 10 ................ 01 ... ..... @c_offs21
448 jirl 0100 11 ................ ..... ..... @rr_i16s2
449 b 0101 00 .......................... @offs26
450 bl 0101 01 .......................... @offs26
451 beq 0101 10 ................ ..... ..... @rr_offs16
452 bne 0101 11 ................ ..... ..... @rr_offs16
453 blt 0110 00 ................ ..... ..... @rr_offs16
454 bge 0110 01 ................ ..... ..... @rr_offs16
455 bltu 0110 10 ................ ..... ..... @rr_offs16
456 bgeu 0110 11 ................ ..... ..... @rr_offs16
458 #
459 # Core instructions
460 #
461 {
462 csrrd 0000 0100 .............. 00000 ..... @r_csr
463 csrwr 0000 0100 .............. 00001 ..... @r_csr
464 csrxchg 0000 0100 .............. ..... ..... @rr_csr
465 }
467 iocsrrd_b 0000 01100100 10000 00000 ..... ..... @rr
468 iocsrrd_h 0000 01100100 10000 00001 ..... ..... @rr
469 iocsrrd_w 0000 01100100 10000 00010 ..... ..... @rr
470 iocsrrd_d 0000 01100100 10000 00011 ..... ..... @rr
471 iocsrwr_b 0000 01100100 10000 00100 ..... ..... @rr
472 iocsrwr_h 0000 01100100 10000 00101 ..... ..... @rr
473 iocsrwr_w 0000 01100100 10000 00110 ..... ..... @rr
474 iocsrwr_d 0000 01100100 10000 00111 ..... ..... @rr
475 tlbsrch 0000 01100100 10000 01010 00000 00000 @empty
476 tlbrd 0000 01100100 10000 01011 00000 00000 @empty
477 tlbwr 0000 01100100 10000 01100 00000 00000 @empty
478 tlbfill 0000 01100100 10000 01101 00000 00000 @empty
479 tlbclr 0000 01100100 10000 01000 00000 00000 @empty
480 tlbflush 0000 01100100 10000 01001 00000 00000 @empty
481 invtlb 0000 01100100 10011 ..... ..... ..... @i_rr
482 cacop 0000 011000 ............ ..... ..... @cop_r_i
483 lddir 0000 01100100 00 ........ ..... ..... @rr_ui8
484 ldpte 0000 01100100 01 ........ ..... 00000 @j_i
485 ertn 0000 01100100 10000 01110 00000 00000 @empty
486 idle 0000 01100100 10001 ............... @i15
487 dbcl 0000 00000010 10101 ............... @i15
489 #
490 # LSX Fields
491 #
493 %i9s3 10:s9 !function=shl_3
494 %i10s2 10:s10 !function=shl_2
495 %i11s1 10:s11 !function=shl_1
496 %i8s3 10:s8 !function=shl_3
497 %i8s2 10:s8 !function=shl_2
498 %i8s1 10:s8 !function=shl_1
500 #
501 # LSX Argument sets
502 #
504 &vv vd vj
505 &cv cd vj
506 &vvv vd vj vk
507 &vv_i vd vj imm
508 &vvvv vd vj vk va
509 &vvv_fcond vd vj vk fcond
510 &vr_i vd rj imm
511 &rv_i rd vj imm
512 &vr vd rj
513 &vvr vd vj rk
514 &vrr vd rj rk
515 &vr_ii vd rj imm imm2
516 &v_i vd imm
518 #
519 # LSX Formats
520 #
521 @vv .... ........ ..... ..... vj:5 vd:5 &vv
522 @cv .... ........ ..... ..... vj:5 .. cd:3 &cv
523 @vvv .... ........ ..... vk:5 vj:5 vd:5 &vvv
524 @vv_ui1 .... ........ ..... .... imm:1 vj:5 vd:5 &vv_i
525 @vv_ui2 .... ........ ..... ... imm:2 vj:5 vd:5 &vv_i
526 @vv_ui3 .... ........ ..... .. imm:3 vj:5 vd:5 &vv_i
527 @vv_ui4 .... ........ ..... . imm:4 vj:5 vd:5 &vv_i
528 @vv_ui5 .... ........ ..... imm:5 vj:5 vd:5 &vv_i
529 @vv_ui6 .... ........ .... imm:6 vj:5 vd:5 &vv_i
530 @vv_ui7 .... ........ ... imm:7 vj:5 vd:5 &vv_i
531 @vv_ui8 .... ........ .. imm:8 vj:5 vd:5 &vv_i
532 @vv_i5 .... ........ ..... imm:s5 vj:5 vd:5 &vv_i
533 @vvvv .... ........ va:5 vk:5 vj:5 vd:5 &vvvv
534 @vvv_fcond .... ........ fcond:5 vk:5 vj:5 vd:5 &vvv_fcond
535 @vr_ui4 .... ........ ..... . imm:4 rj:5 vd:5 &vr_i
536 @vr_ui3 .... ........ ..... .. imm:3 rj:5 vd:5 &vr_i
537 @vr_ui2 .... ........ ..... ... imm:2 rj:5 vd:5 &vr_i
538 @vr_ui1 .... ........ ..... .... imm:1 rj:5 vd:5 &vr_i
539 @rv_ui4 .... ........ ..... . imm:4 vj:5 rd:5 &rv_i
540 @rv_ui3 .... ........ ..... .. imm:3 vj:5 rd:5 &rv_i
541 @rv_ui2 .... ........ ..... ... imm:2 vj:5 rd:5 &rv_i
542 @rv_ui1 .... ........ ..... .... imm:1 vj:5 rd:5 &rv_i
543 @vr .... ........ ..... ..... rj:5 vd:5 &vr
544 @vvr .... ........ ..... rk:5 vj:5 vd:5 &vvr
545 @vr_i9 .... ........ . ......... rj:5 vd:5 &vr_i imm=%i9s3
546 @vr_i10 .... ........ .......... rj:5 vd:5 &vr_i imm=%i10s2
547 @vr_i11 .... ....... ........... rj:5 vd:5 &vr_i imm=%i11s1
548 @vr_i12 .... ...... imm:s12 rj:5 vd:5 &vr_i
549 @vr_i8i1 .... ........ . imm2:1 ........ rj:5 vd:5 &vr_ii imm=%i8s3
550 @vr_i8i2 .... ........ imm2:2 ........ rj:5 vd:5 &vr_ii imm=%i8s2
551 @vr_i8i3 .... ....... imm2:3 ........ rj:5 vd:5 &vr_ii imm=%i8s1
552 @vr_i8i4 .... ...... imm2:4 imm:s8 rj:5 vd:5 &vr_ii
553 @vrr .... ........ ..... rk:5 rj:5 vd:5 &vrr
554 @v_i13 .... ........ .. imm:13 vd:5 &v_i
556 vadd_b 0111 00000000 10100 ..... ..... ..... @vvv
557 vadd_h 0111 00000000 10101 ..... ..... ..... @vvv
558 vadd_w 0111 00000000 10110 ..... ..... ..... @vvv
559 vadd_d 0111 00000000 10111 ..... ..... ..... @vvv
560 vadd_q 0111 00010010 11010 ..... ..... ..... @vvv
561 vsub_b 0111 00000000 11000 ..... ..... ..... @vvv
562 vsub_h 0111 00000000 11001 ..... ..... ..... @vvv
563 vsub_w 0111 00000000 11010 ..... ..... ..... @vvv
564 vsub_d 0111 00000000 11011 ..... ..... ..... @vvv
565 vsub_q 0111 00010010 11011 ..... ..... ..... @vvv
567 vaddi_bu 0111 00101000 10100 ..... ..... ..... @vv_ui5
568 vaddi_hu 0111 00101000 10101 ..... ..... ..... @vv_ui5
569 vaddi_wu 0111 00101000 10110 ..... ..... ..... @vv_ui5
570 vaddi_du 0111 00101000 10111 ..... ..... ..... @vv_ui5
571 vsubi_bu 0111 00101000 11000 ..... ..... ..... @vv_ui5
572 vsubi_hu 0111 00101000 11001 ..... ..... ..... @vv_ui5
573 vsubi_wu 0111 00101000 11010 ..... ..... ..... @vv_ui5
574 vsubi_du 0111 00101000 11011 ..... ..... ..... @vv_ui5
576 vneg_b 0111 00101001 11000 01100 ..... ..... @vv
577 vneg_h 0111 00101001 11000 01101 ..... ..... @vv
578 vneg_w 0111 00101001 11000 01110 ..... ..... @vv
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