target/mips: Replace gen_exception_end(EXCP_RI) by gen_rsvd_instruction
[qemu/ar7.git] / target / openrisc / 
tree06ebbc822f0c0c729c5d8b00e69d0eb92772f52a
drwxr-xr-x   ..
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-rw-r--r-- 11570 cpu.h
-rw-r--r-- 9029 disas.c
-rw-r--r-- 1008 exception.c
-rw-r--r-- 968 exception.h
-rw-r--r-- 1568 exception_helper.c
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-rw-r--r-- 8620 insns.decode
-rw-r--r-- 3810 interrupt.c
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-rw-r--r-- 6013 mmu.c
-rw-r--r-- 9743 sys_helper.c
-rw-r--r-- 46978 translate.c