include/hw/intc/bcm2836_control.h.orig

   1 /*
   2  * Raspberry Pi emulation (c) 2012 Gregory Estrade
   3  * Upstreaming code cleanup [including bcm2835_*] (c) 2013 Jan Petrous
   4  *
   5  * Rasperry Pi 2 emulation and refactoring Copyright (c) 2015, Microsoft
   6  * Written by Andrew Baumann
   7  *
   8  * This code is licensed under the GNU GPLv2 and later.
   9  */
  10
  11 #ifndef BCM2836_CONTROL_H
  12 #define BCM2836_CONTROL_H
  13
  14 #include "hw/sysbus.h"
  15
  16 /* 4 mailboxes per core, for 16 total */
  17 #define BCM2836_NCORES 4
  18 #define BCM2836_MBPERCORE 4
  19
  20 <<<<<<< HEAD
  21 #define TYPE_BCM2836_CONTROL "bcm2836_control"
  22 =======
  23 #define TYPE_BCM2836_CONTROL "bcm2836-control"
  24 >>>>>>> upstreaming-raspi
  25 #define BCM2836_CONTROL(obj) \
  26     OBJECT_CHECK(BCM2836ControlState, (obj), TYPE_BCM2836_CONTROL)
  27
  28 typedef struct BCM2836ControlState {
  29     /*< private >*/
  30     SysBusDevice busdev;
  31     /*< public >*/
  32     MemoryRegion iomem;
  33
  34     /* interrupt status registers (not directly visible to user) */
  35     bool gpu_irq, gpu_fiq;
  36 <<<<<<< HEAD
  37     uint32_t localirqs[BCM2836_NCORES];
  38 =======
  39     uint8_t localirqs[BCM2836_NCORES];
  40 >>>>>>> upstreaming-raspi
  41
  42     /* mailboxes */
  43     uint32_t mailboxes[BCM2836_NCORES * BCM2836_MBPERCORE];
  44
  45     /* interrupt routing/control registers */
  46     uint8_t route_gpu_irq, route_gpu_fiq;
  47     uint32_t timercontrol[BCM2836_NCORES];
  48     uint32_t mailboxcontrol[BCM2836_NCORES];
  49
  50     /* interrupt source registers, post-routing (visible) */
  51     uint32_t irqsrc[BCM2836_NCORES];
  52     uint32_t fiqsrc[BCM2836_NCORES];
  53
  54     /* outputs to CPU cores */
  55     qemu_irq irq[BCM2836_NCORES];
  56     qemu_irq fiq[BCM2836_NCORES];
  57 } BCM2836ControlState;
  58
  59 #endif