igd.asl rewrite
[coreboot.git] / src / northbridge / intel / i945 / Kconfig
blobb17dda6901eaa74f11c15f1fe4767575debf4c31
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2 ## This file is part of the coreboot project.
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4 ## Copyright (C) 2007-2009 coresystems GmbH
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6 ## This program is free software; you can redistribute it and/or modify
7 ## it under the terms of the GNU General Public License as published by
8 ## the Free Software Foundation; version 2 of the License.
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10 ## This program is distributed in the hope that it will be useful,
11 ## but WITHOUT ANY WARRANTY; without even the implied warranty of
12 ## MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
13 ## GNU General Public License for more details.
15 ## You should have received a copy of the GNU General Public License
16 ## along with this program; if not, write to the Free Software
17 ## Foundation, Inc.
20 config NORTHBRIDGE_INTEL_I945
21         bool
23 if NORTHBRIDGE_INTEL_I945
25 config NORTHBRIDGE_SPECIFIC_OPTIONS # dummy
26         def_bool y
27         select MMCONF_SUPPORT
28         select MMCONF_SUPPORT_DEFAULT
29         select HAVE_DEBUG_RAM_SETUP
30         select LAPIC_MONOTONIC_TIMER
31         select VGA
32         select INTEL_GMA_ACPI
34 config NORTHBRIDGE_INTEL_SUBTYPE_I945GC
35         def_bool n
36 config NORTHBRIDGE_INTEL_SUBTYPE_I945GM
37         def_bool n
39 config BOOTBLOCK_NORTHBRIDGE_INIT
40         string
41         default "northbridge/intel/i945/bootblock.c"
43 config VGA_BIOS_ID
44         string
45         default "8086,27a2"
47 config CHANNEL_XOR_RANDOMIZATION
48         bool
49         default n
51 config OVERRIDE_CLOCK_DISABLE
52         bool
53         default n
54         help
55           Usually system firmware turns off system memory clock
56           signals to unused SO-DIMM slots to reduce EMI and power
57           consumption.
58           However, some boards do not like unused clock signals to
59           be disabled.
61 config MAXIMUM_SUPPORTED_FREQUENCY
62         int
63         default 0
64         help
65           If non-zero, this designates the maximum DDR frequency
66           the board supports, despite what the chipset should be
67           capable of.
69 config CHECK_SLFRCS_ON_RESUME
70         def_bool n
71         help
72           On some boards it may be neccessary to hard reset early
73           during resume from S3 if the SLFRCS register indicates that
74           a memory channel is not guaranteed to be in self-refresh.
75           On other boards the check always creates a false positive,
76           effectively making it impossible to resume.
78 endif