docs/system/openrisc/emulation.rst

   1 OpenRISC 1000 CPU architecture support
   2 ======================================
   3
   4 QEMU's TCG emulation includes support for the OpenRISC or1200 implementation of
   5 the OpenRISC 1000 cpu architecture.
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   7 The or1200 cpu also has support for the following instruction subsets:
   8
   9 - ORBIS32 (OpenRISC Basic Instruction Set)
  10 - ORFPX32 (OpenRISC Floating-Point eXtension)
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  12 In addition to the instruction subsets the QEMU TCG emulation also has support
  13 for most Class II (optional) instructions.
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  15 For information on all OpenRISC instructions please refer to the latest
  16 architecture manual available on the OpenRISC website in the
  17 `OpenRISC Architecture <https://openrisc.io/architecture>`_ section.